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PCS3115 - Sistemas Digitais I (2020S1)
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SD-1 2020S1
Aula 14 - Somadores e Subtratores
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Projeto 1 VHDL (Resto da Divisão) - Enunciado
Projeto 1 - Resto da Divisão (Prazo 8 de julho, quarta-feira, 23:59)
Projeto 2 VHDL (Log2) - Enunciado
Projeto 2 - log2 (Prazo 15 de julho, quarta-feira, 23:59)
Projeto 3 VHDL (Controle Turbo) - Enunciado
Projeto 3 - Turbo (Prazo 29 de julho, quarta-feira, 23:59)
Projeto 4 VHDL (Little Sort) - Enunciado
Projeto 4 VHDL (LittleSort) - littlesort_fd_fornecido.vhd
Projeto 4 VHDL (LittleSort) - littlesort_testbench_uc_sd_ram_fornecido.zip
Projeto 4 - LittleSort (Prazo 29 de julho, quarta-feira, 23:59)
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Anexo - Arquivos VHDL dos testbenches (v2) da aula 15
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Aula 15 online - 29/04/2020 (Projeto de circuitos digitais com VHDL)
Vídeo-aula sobre Latches e Flip-Flops (Parte 1 de 2)
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Videoaula sobre Síntese de Circuitos Sequenciais (Parte 1)
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Vídeo-Aula Parte-I Registradores de Propósito Geral
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Vídeo-Aula Parte-II Contadores Assíncronos
SLIDES-Aula22-ContadoresSincronos-Parte-III-2020S1
Vídeo-Aula Parte-III Contadores Síncronos
pcs3115-Aula22-ContadoresSincronos-Exercicios-Parte -IV-2020S1
SLIDES-Aula22-Registradores + Contadores-2020-Atualizacao
Video-Aula22-ContadoresSincronos-Exercicios-Parte -IV
Gravação da Aula 22 on-line
SLIDES-Aula23-Registradores + Contadores-2020
SLIDES-Aula23-DeslocadoresEmAnel-AnelTorcido-Parte-I-2020S1
Video-Aula23-DeslocadoresEmAnel-AnelTorcido-Parte-I
SLIDES-Aula23-Parte-II-LinearFeedbackShiftRegisters-LFSRs-2020S1
Vídeo-Aula23 LinearFeedbackShiftRegisters-LSFRs Parte 2
PCS3115-VideoAula 23-On-line-10-06-Q-Registradores Deslocadores.
(Videoaula 1) Memórias: Tipos
(Videoaula 2) Memórias: Capacidade e Arquitetura
(Videoaula 3) Dispositivos de Lógica Programável: Memórias e FPGAs
Slides da videoaula (inclui exercícios resolvidos)
Gravação - Google Meet
Vídeo-aula (1 de 2) - Diagramas ASM
Vídeo-aula (2 de 2) - Projeto de Sistemas Digitais
Slides (1 de 2) - Diagramas ASM
Slides (2 de 2) - Projetos de Sistemas Digitais
Multiplicador em VHDL
Gravação da Aula ao Vivo
VHDL - Conversão entre tipos de dados
Projeto VHDL - Enunciado (submissão para juiz)
Entitdade VHDL: para completar
Gravação Google Meet (22-Jun-2020)
Encontro síncrono - 22-Jun-2020 (Slides com dicas do projeto)
Projeto VHDL - Enunciado (submissão para juiz)
Entidade VHDL: para completar
Encontro síncrono - 24-Jun-2020 (Slides com dicas do projeto)
Gravação Google Meet
Projeto4 - Little Sort - Enunciado
Projeto4 - Little Sort - Aula28 on-line - 08/07 - 13:10 horas
Aula28 on-line - Projeto4 - Little Sort
SLIDES-Aula28-ProjetoLittleSort-2020S1-v.1.7
SLIDES-SCs-ExpressoesAlgebricas-EAD-Parte2 ►